八個低RDSon數(shù)據(jù)輸出

（25°C時IO=1A時為0.5Ω，VCC=5V±5%）

8位串行輸入數(shù)據(jù)（SPI）

8位串行診斷輸出

過載和開路條件

輸出短路保護(hù)

CHIPENABLESELECTFUNCTION（低電平有效）

每個輸出的內(nèi)部36V夾緊

與另一個八進(jìn)制級聯(lián)

低靜態(tài)電流（最大10mA）

PowerSO20套餐

說明

L98SI是一種低壓側(cè)電磁閥驅(qū)動器rea采用多電源BCD技術(shù)，專門用于工業(yè)中的驅(qū)動燈、繼電器和電磁閥沖突環(huán)境L98SI DMOS輸出非常低的功耗。數(shù)據(jù)通過串行方式傳輸?shù)皆O(shè)備串行外圍接口（SPI）協(xié)議。L98SI具有輸出狀態(tài)監(jiān)測功能功能。

管腳說明

VCC公司

標(biāo)稱電源電壓-5V

接地

設(shè)備地面。這個邏輯電路和功率輸出級的接地裝置。

重置

異步復(fù)位L98內(nèi)部的輸出級、并行鎖存器和移位寄存器是的。這個引腳為低激活狀態(tài)，不得帶浮動。可實現(xiàn)電源開啟清除功能，將該引腳連接至VCC，并連接至用外部電容器接地。

總工程師

芯片啟用。數(shù)據(jù)從移位寄存器傳輸?shù)叫盘柹仙氐妮敵龆恕Ｔ撔盘柕南陆笛卦O(shè)置移位寄存器輸出電壓檢測位來自輸出級。SO引腳的輸出驅(qū)動器是此引腳低時啟用。所以串行輸出。此引腳是移位寄存器，當(dāng)CE高時，它是三態(tài)的。A此管腳上的數(shù)據(jù)位為高表示特殊輸出為高。該引腳上的數(shù)據(jù)位低表示輸出低。將串行輸出位與前一位進(jìn)行比較串行輸入位外部微控制器實現(xiàn)L98SI提供的診斷數(shù)據(jù)。

硅

串行輸入。該引腳是串行數(shù)據(jù)輸入。高潮在此Pin上，將編程一個ParticularRoutPuttoBeoff，低氣壓會打開它。

SCLK公司

串行時鐘。該引腳為移位寄存器計時。新的所以數(shù)據(jù)會出現(xiàn)在這個引腳的每一個上升沿上新的數(shù)據(jù)將被鎖存到每一個slk's fal  ling edge到移位寄存器中。輸出00-07電源輸出引腳輸入和輸出位與07位相對應(yīng)，首先通過SPI接收公共汽車和00是最后。輸出端提供限流和電壓傳感器故障功能指示和保護(hù)。額定負(fù)載電流這些輸出為500mA，但電流限制設(shè)置為最小值1.05A。輸出也有車載夾具設(shè)置為約36V用于再循環(huán)感應(yīng)負(fù)載電流。

電氣特性（VCC=5V±5%。Tj=–40至125°C；除非另有規(guī)定）

功能描述

L98SiDMOSoutputisa低工作功率副功能，8個1ΩRDSON DMOS驅(qū)動器輸出級瞬態(tài)保護(hù)電路。每個通道由輸出獨(dú)立控制鎖存器和一個公用的重置線路，可以禁用所有八分之一。流量低飽和和短路電路保護(hù)和驅(qū)動電阻電磁閥、燈和繼電器等負(fù)載。數(shù)據(jù)是使用串行Pe 三層接口（SPI）串行傳輸設(shè)備協(xié)議。那個電路接收序列輸入（SI）的8位串行數(shù)據(jù)傳輸存儲在內(nèi)部寄存器中以控制輸出司機(jī)。串行輸出（SO）提供8位代表dri-ver輸出電壓電平的直徑數(shù)據(jù)。這允許微處理器診斷輸出驅(qū)動器的狀況。輸出飽和電壓由不飽和狀態(tài)的比較器能夠通過斷層打開特定河流重置線路。該電路還可與其他八進(jìn)制驅(qū)動器級聯(lián)，以阻塞8位多個數(shù)據(jù)。芯片啟用（CE）時選擇設(shè)備線路低。另外，（SO）被置于三態(tài)模式取消選擇設(shè)備時。負(fù)邊緣（CE）傳輸驅(qū)動器的電壓電平對移動寄存器和（CE）的積極影響將來自換檔寄存器的新數(shù)據(jù)鎖存到兩個驅(qū)動器上。當(dāng)CE低時，數(shù)據(jù)位包含在移位寄存器每數(shù)據(jù)位存在于SI時的SCLK正躍遷輸入被鎖存到移位寄存器負(fù)遷移。

內(nèi)部塊說明

設(shè)備的內(nèi)部架構(gòu)基于三個內(nèi)部主塊：用于與SPI總線對話的八進(jìn)制移位寄存器、寫入設(shè)備的控制位的八進(jìn)制鎖和八進(jìn)制加載驅(qū)動程序數(shù)組。

移位寄存器

移位寄存器有串行和并行輸入以及串行和并行輸出。串行輸入ac接收來自SPIBUS的數(shù)據(jù)，串行輸出同時將數(shù)據(jù)發(fā)送到SPI總線。這個平行輸出鎖緊在L98S端部的平行鎖銷側(cè)數(shù)據(jù)傳輸pa 集合將JAM診斷數(shù)據(jù)輸入換檔寄存器在數(shù)據(jù)傳輸周期的開始。

平行閂鎖

并行鎖存器保存來自移位的輸入數(shù)據(jù)注冊。然后這些數(shù)據(jù)驅(qū)動輸出級。鎖存器中的單個寄存器可以通過以保護(hù)過載的故障條件輸出階段。整個鎖閂也被清除了通過復(fù)位信號。

輸出級

輸出級提供主動低驅(qū)動信號適用于0.75A連續(xù)負(fù)載。每個輸出有一個電流限制電路輸出電流至少為1.05A，以允許高in 急流。另外，輸出內(nèi)部齊納值設(shè)置為36伏以鉗制感應(yīng)瞬變在關(guān)閉時。每個輸出也有一個電壓比較表輸出節(jié)點(diǎn)。如果on輸出引腳上的電壓超過1.8V，則故障為假設(shè)和鎖閂驅(qū)動這個特定的階段復(fù)位，關(guān)閉輸出以保護(hù)它。此操作的說明如下。這些組件還提供診斷反饋數(shù)據(jù)給轉(zhuǎn)變注冊。另外，比較器為臺南內(nèi)部下拉電流如果輸出為程序關(guān)閉，輸出引腳開路。定時數(shù)據(jù)傳輸圖2顯示了使用SPI與L98SI進(jìn)行字節(jié)傳輸公共汽車。

CE高-低過渡

當(dāng)芯片啟用（CE）引腳為拉低。Thetri-stateSerialOutput（SO）引腳驅(qū)動程序?qū)⑹笴E較低的時間成為可能。在CE引腳的邊緣，診斷數(shù)據(jù)來自輸出級中的電壓比較器將接入移位寄存器。如果特定輸出是高，一個邏輯信號會被塞進(jìn)移位寄存器。如果輸出低，邏輯零將在這里裝的最重要的位（07）應(yīng)該是顯示串行輸入（SI）引腳。一個零引腳將編程一個輸出，而一個將編程輸出關(guān)閉。

SCLK躍遷

然后應(yīng)拔出串行時鐘（SCLK）引腳高。在這一點(diǎn)上，來自最重要輸出（07）的診斷位將出現(xiàn)在最高點(diǎn)這里表示07針腳高于1.8V。然后將SCLK引腳調(diào)低至高。新的SO數(shù)據(jù)將出現(xiàn)在每個邊緣之后的SCLK和新的SI數(shù)據(jù)將被鎖存到L98S換檔寄存器下降邊緣。無限制數(shù)據(jù)量可以通過設(shè)備進(jìn)行移位移位寄存器（輸入SI引腳，輸出SO引腳），允許其他SPI設(shè)備與L98SI一起封裝在dai  sy鏈中。CE低到高轉(zhuǎn)變一旦最后一個數(shù)據(jù)位移到L98SI，CE銷應(yīng)拉高。在CE的上升沿，移位寄存器數(shù)據(jù)是橫向的，輸出級將由新數(shù)據(jù)驅(qū)動。內(nèi)部160μs延遲定時器也將在該上升沿啟動（參見圖德）。在160μs期間，輸出將為僅由模擬限流電路保護(hù)由于故障導(dǎo)致平行鎖存復(fù)位條件它持續(xù)了一段時間。這個降低部件，以克服高涌流打開后可能立即流動。一旦延遲時間已過，輸出電壓為通過比較器和任何體積大于1.8的輸出進(jìn)行感應(yīng)瓦雷拉切多夫，應(yīng)該是注意，SCLK引腳在CE引腳的兩個傳輸位置都應(yīng)較低，以避免換檔注冊.thescrk輸入由計算機(jī)控制使SCLK引腳在CE引腳高。

故障條件檢查

可以用以下方法檢查故障情況。輸入新的控制字節(jié)。等等160微秒左右，以使輸出穩(wěn)定下來。在同一個控制器上計時，并觀察設(shè)備輸出的診斷數(shù)據(jù)。診斷位應(yīng)與第一次打卡。任何不同之處都會指向錯誤打開輸出。如果輸出由計時為0，1作為輸出的直徑，輸出pin仍然很高并且存在短路或過載情況。如果輸入1時，輸出被編程關(guān)閉，一個零作為診斷的依據(jù)回來了輸出，沒有把輸出引腳拉高

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